第1题
试用J—K触发器构成一个模8格雷码同步计数器(画出逻辑图)。
请帮忙给出正确答案和分析,谢谢!
第2题
按上题的分配结果,用D触发器实现之。
第3题
状态分配及状态表如表5—18所示。分别写出采用D触发器、J-K触发器时的激励方程和输出方程,并画出逻辑图。
第4题
用VHDL描述下列器件的功能: (1)4选1数据选择器; (2)2线-4线译码器; (3)时钟R-S触发器; (4)带复位端Clear和置位端Preset、延迟Tpd为20ns的响应CP下降沿的J-K触发器; (5)主从J-K触发器; (6)集成计数器74163; (7)集成移位寄存器74194。
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