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一个4位二进制加法计数器,对输入脉冲计数,设计数器的初始状态为0,则输入7个脉冲后,计数器的状态是

答案
0111
更多“一个4位二进制加法计数器,对输入脉冲计数,设计数器的初始状态为0,则输入7个脉冲后,计数器的状态是”相关的问题

第1题

对一5位同步二进制加法计数器,说法错误的是

A.其计数容量为32

B.其模为32

C.其最高位可得32分频

D.该计数器易产生竞争-冒险现象

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第2题

根据计数状态的改变规律,可分为加法计数器和减法计数器
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第3题

考虑到触发器的触发特性,用 构成异步二进制加法计数器应最简单

A.T’触发器

B.T触发器

C.D触发器

D.JK触发器

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第4题

构造一个十进制的异步加法计数器,需要个触发器

A.2

B.3

C.4

D.10

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第5题

BCD码是一组4位二进制数,能表示16以内的任何一个十进制数
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第6题

二进制并行加法器除实现二进制加法运算外,还可实现等功能

A.十进制加法运算

B.二进制乘法运算

C.二进制减法运算

D.代码转换

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第7题

BCD码是一组4位二进制数,能表示16以内的任何一个十进制数
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第8题

4位二进制译码器有个输出信号端。4位二进制译码器有个输出信号端

A.4

B.8

C.16

D.32

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第9题

要对9路输入信号进行编码,至少需要

A.9位二进制

B.6位二进制

C.5位二进制

D.4位二进制

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第10题

一个常数是4位二进制数1101,在Verilog语言中表示为

A.4‘b1101

B.4'14

C.4‘o17

D.4’hE

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