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[单选题]

若CPU地址线共16条，某存储芯片容量为2K，这加在该存储器芯片上的地址线为（）。

A.A0~A10

B.A0~A11

C.A0~A16

D.A0~A15

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第1题

用1024×1位的RAM芯片组成16K×8位的存储器，需要多少个芯片?分为多少组?共需多少根地址线?地址线如何分配?试画出与CPU的连接框图。

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第2题

用64K×8的RAM芯片和32K×16的ROM芯片设计一个256K×16的存储器，地址范围为00000H～3FFFFH，其中ROM的地址范围为10000H～1FFFFH，其余为RAM的地址。则地址线为(1)根，数据线为(2)根；ROM需要(3)片，RAM需要(4)片。

CPU执行一段程序时，Cache完成存取的次数为5000次，主存完成存取的次数为200次。已知Cache的存取周期为40ns，主存的存取周期为160ns。其两级存储器的平均访问时间为(5)ns。

A．18

B．9

C．16

D．8

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第3题

设某微型计算机的寻址范围为64K ,接有8片8K的存储芯片,存储芯片的片选信号为。要求:

(1)画出选片译码逻辑电路(可选用74138译码器)。

(2)写出每片RAM的地址范围。

(3)如果运行时发现不论往哪片RAM存放8K数据，以4000H为起始地址的存储芯片都有与之相同的数据，分析故障原因。

(4)若出现译码中的地址线A,与CPU断线,并搭接到地电平上的故障,后果如何?

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第4题

设某微机的寻址范围为64K,接有8片8K的存储芯片,存储芯片的片选信号为,要求:

(1)画出选片译码逻辑电路(可选用74138译码器)。

(2)写出每片RAM的地址范围。

(3)如果运行时发现不论往哪片RAM存放8K数据,以A000H为起始地址的存储芯片都有与之相同的数据,分析故障原因。

(4)若出现译码中的地址线A13与CPU断线,并搭接到高电平上的故障，后果如何?

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第5题

设CPU地址总线有24根，数据总线有32根，用512K×8位的RAM芯片构成该机的主存储器，则该机主存最多需要（ ）片这样的存储芯片。

A．256

B．512

C．64

D．128

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第6题

设CPU共有16根地址线,8根数据线,并用 作为访存控制信号(低电平有效),用 作为读／写控制信号
设CPU共有16根地址线,8根数据线,并用作为访存控制信号(低电平有效),用作为读/写控制信号(高电平为读,低电平为写)。现有芯片及各种门电路(门电路自定),如图4.16所示。西出CPU与存储器的连接图,要求:

(1)存储芯片地址空间分配:最小4K地址空间为系统程序区;相邻的4K地址空间为系统程序工作区;与系统程序工作区相邻的是24K用户程序区。

(2)指出选用的存储芯片类型及数量。

(3)详细画出片选逻辑。

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第7题

某8位CPU公有20根地址线（A19~A0），8根数据线（D7~D0），现用4片256K*8位的存储器芯片（Chip3~Chip0）采用4体交叉方式、字扩展，构成该CPU的最大存储空间，Chip3构成高位字节。若CPU要访问地址为12345H的内存单元，则应将（ ）的片选设为有效。

A、Chip3

B、Chip2

C、Chip1

D、Chip0

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第8题

某8位CPU共有20根地址线（A19~A0），8根数据线（D7~D0），现用4片256K*8位的存储器芯片（Chip0~Chip3）采用4体交叉方式、字扩展（译码器输出端的Y0~Y3分别接chip0~chip3的片选），构成该CPU的最大存储空间。若CPU要访问地址为12345H的内存单元，则应将（ ）的片选设为有效。

A、Chip3

B、Chip2

C、Chip1

D、Chip0

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第9题

为8088CPU应用系统设计一个32K×8的随机读写存储器，起始地址为68000H。系统具有20根地址线A19—A0,8根数据线D7—D0。要求用INTEL6264 SRAM（8K×8）存储器芯片和74LS138译码器设计。具体要求如下： (1) 需几个SRAM芯片？ (2) 片内地址线有多少根？ (3) 存储器的末地址是多少？
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第10题

设存储器的地址线有16条，基本存储单元为字节，若采用2K×4位芯片，按全译码方法组成按字节编址的存储器，当该存储器被扩充成最大容量时，需要此种存储2S芯片的数量是【 】片。

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